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RTL Design Engineer (HW IP)

딥엑스|2026. 9. 9. 게시|
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공고 요약

경력5년 이상
채용 유형정규직
학력학사
지역경기
마감일D-3
출처잡아바

자격요건

  • C++ 사용 역량

  • Perl 사용 역량

  • Python 사용 역량

  • Verilog 사용 역량

  • Linux 환경 경험

  • ASIC 설계 경험

  • FPGA 설계 경험

  • RTL 설계 경험

  • System C 사용 경험

  • PPA Estimation 경험

보상과 복리후생

  • 급여 면접 후 결정

  • 성과급

  • 아침·점심·저녁 식사 지원

  • 스톡옵션

  • 명절선물·명절상여

  • 국민연금·고용보험·산재보험·건강보험

  • 경조휴가

전형절차

  • 홈페이지 지원

근무환경

주5일 근무, 월요일부터 금요일까지 09:00~18:00

마감기한

2026년 9월 14일 08:00까지

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공고 원문

딥엑스 RTL Design Engineer (HW IP) 채용공고
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