RTL Design Engineer (HW IP)
공고 요약
경력5년 이상
채용 유형정규직
학력학사
지역경기
마감일마감
출처잡아바
주요업무
RTL 설계
HW IP 설계
ASIC 및 FPGA 관련 설계
PPA Estimation
자격요건
C++, Perl, Python, Verilog, Linux, System C 활용 역량
ASIC, FPGA, RTL 관련 경험
보상과 복리후생
성과급
스톡옵션
아침 식사 지원
점심 식사 지원
저녁 식사 지원
명절선물 및 명절상여
4대보험
경조휴가
근무환경
주5일 근무
09:00~18:00 근무
접수방법
홈페이지 지원
마감기한
2026년 9월 7일 08:00까지
공고 원문
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