Lead DFT Engineer
공고 요약
직행담당업무
DFT 아키텍처 및 기능 구현·검증
Scan 삽입 및 ATPG 패턴 생성
게이트 레벨 시뮬레이션을 통한 ATPG 패턴 검증
테스트 커버리지 및 테스트 비용 절감 분석
실리콘 초기 구동 지원 및 수율 학습 개선
우대 경험
DFT 방법론 및 DFT 검증 경험
IEEE1500, JTAG 1149.x, Scan, 메모리 BIST 이해
Mentor TestKompress 또는 Synopsys Tetramax/DFTMAX 경험
VCS 시뮬레이션 도구, Perl/Shell 스크립팅, Verilog RTL 설계 경험
지원자 역량
정확성과 세부 사항에 대한 주의력
원활한 의사소통 및 문제 해결 역량
시니어 실리콘 설계 엔지니어와의 협업
채용 및 지원 안내
지원자 심사·평가·선발 과정에서 인공지능을 활용할 수 있음
Responsible AI Policy 안내
평등고용 및 채용 전 과정의 지원자 편의 제공
마감기한
상시채용
공고 원문
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